Dr.-Ing. Jan Moritz Joseph ist seit Juli 2020 an der RWTH Aachen beschäftigt.

Institut für Kommunikationstechnologie und Eingebettete Systeme

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Lebenslauf

Dr.-Ing. Jan Moritz Joseph wurde in Berlin im Jahr 1990 geboren. Er hat seinen B.Sc. Abschluss im Fach Medizinische Ingenieurwissenschaften im Jahr 2011 und seinen M.Sc. Abschluss in Informatik in 2014 von der Universität zu Lübeck erhalten. Von 2008 bis 2014 war er Stipendiat der Studienstiftung des Deutschen Volkes. Im August 2019 erhiet er seine Promotion mit dem Prädikat "summa cum laude" über das Thema "Networks-on-Chip for heterogeneous 3D Systems-on-Chip" verliehen durch die Fakultät für Elektro- und Informationstechnik durch die Otto-von-Guericke Universität Magdeburg. Von September 2019 bis März 2020 ist Herr Dr. Joseph als Visiting Research Scholar amGeorgia Institute of Technologie tätig in Prof. Tushar Krishnas Gruppe. Außerdem arbeitet er im Moment als PostDoc an der Otto-von-Guericke-Universität Magdeburg am Institut für Informations- und Kommunikationstechnik.

Der Fokus von Herrn Joseph Tätigkeit liegt auf der Erforschung von Kommunikationsarchitekturen für heterogene 3D Integration in verschiedenen Anwendungsgebieten. Aktuell liegt der Fokus auf systlischen Arrays als Beschleunigerarchitekturen für CNNs. Auch nach seiner Promotion untersucht er weiterhin Network-on-Chips, da diese eine skalierbare Kommunikationsinfrastuktur für moderne Mehrkernsysteme darstellen. Seine zwei Bereiche besonderen Interesses sind die Priorisierung von semi-statischen Datenströmen für on-chip Netzwerke und asymmetrische 3D-Network-on-Chips.

Forschungsschwerpunkte

• Kommunikationsnetze
• heterogene 3D Integration
• Computer Architecture
• EDA Optimiung und Entwurf von Network-on-Chips (NoCs) und System-on-Chips (SoCs)
• Modellierung und Simulation

Projekte

• Bearbeitung von DFG-Project "Erkennung und adaptive Priorisierung von semi-statischen Datenströmen und von Verkehrsstrommustern in Network-on-Chips"
• Bearbeitung von DFG-Project "Technology-aware Asymmetric 3D-Interconnect Architectures: Templates and Design Methods"
• Ratatoskr: Framework for in-depth PPA analysis for 3D-NoCs, zu finden auf Github

Abschlussarbeiten

Ich biete gerne Abschlussarbeiten zu aktuellen Forschungsthemen an. Eine Übersicht über aktuelle Themen finden Sie hier. Themen können nach Rücksprache ggf. in Projekten bearbeitet werden.

HiWis gesucht!

Wir sind auf der Suche nach HiWis, die an unserem Forschungsprojekt über A-3D-NoCs mitarbeiten möchten. Hier finden Sie eine Beschreibung der Aufgaben, aktuelle Themen, und Anforderungen.

Veröffentlichungen

vollwertige Veröffentlichungen

2020	Jan Moritz Joseph, Dominik Ermel, Lennart Bamberg, Alberto García-Ortiz, Thilo Pionteck: “Application-Specific SoC Design Using Core Mapping to 3D Mesh NoCs with Nonlinear Area Optimization and Simulated Annealing”, Technologies 8.1 (2020): 10.
2020	Ananda Samajdar, Jan Moritz Joseph, Yuhao Zhu, Paul Whatmough, Matthew Mattina, Tushar Krishna: “A Systematic Methodology for Characterizing Scalability of DNN Accelerators”, International Symposium on Performance Analysis of Systems and Software (ISPASS), Boston, MA (accepted, unpublished).
2020	Anna Drewes, Jan Moritz Joseph, Bala Gurumurthy, David Broneske, Sajjad Tamimi, Gunter Saake, Thilo Pionteck: “Optimising Operator Sets for Analytical Database Processing on FPGAs”, International Symposium on Applied Reconfigurable Computing (ARC), Toledo, Spain (accepted, unpublished).
2019	Jan Moritz Joseph, Dominik Ermel, Lennart Bamberg, Alberto García-Ortiz, Thilo Pionteck: “System-level optimization of Network-on-Chips for heterogeneous 3D System-on-Chips”, International Conference on Computer Design (ICCD), Abu Dhabi, VAE, doi: 10.1109/ICCD46524.2019.000. Acceptance rate: 31.8%
2019	Joseph, J. M., Bamberg, L., Ermel, D., Perjikolaei, B. R., Drewes, A., García-Oritz, A., & Pionteck, T. (2019). NoCs in Heterogeneous 3D SoCs: Co-Design of Routing Strategies and Microarchitectures. IEEE Access, 10.1109/ACCESS.2019.2942129, 2019.
2019	JM Joseph, L Bamberg, I Hajjar, R Schmidt, T Pionteck, A García-Ortiz: Simulation environment for link energy estimation in networks-on-chip with virtual channels, Integration.
2019	L Bamberg, JM Joseph, T Pionteck, A Garcia-Ortiz: Crosstalk optimization for through-silicon vias by exploiting temporal signal misalignment, Integration 67, 60-72
2019	Jan Moritz Joseph, Dominik Ermel, Tobias Drewes, Lennart Bamberg, Alberto Garcia-Ortiz, and Thilo Pionteck: Area Optimization with Non-linear Models in Core Mapping for System-on-Chips, MOCAST, Thessaloniki, Greece, 2019. 10.1109/MOCAST.2019.8742035
2018	Jan Moritz Joseph, Lennart Bamberg, Krell Gerald, Hajjar Imad, Alberto Garcia-Ortiz, and Thilo Pionteck: Specification of Simulation Models for NoCs in Heterogeneous 3D SoCs, ReCoSoC, France, 2018.
2018	Lennart Bamberg, Jan Moritz Joseph, Robert Schmidt, Thilo Pionteck and Alberto Garcia-Ortiz: Coding-aware Link Energy Estimation for 2D and 3D Networks-on-Chip with Virtual Channels, PATMOS, Spain, 2018.
2018	T. Drewes, J. M. Joseph, B. Gurumurthy, D. Broneske, G. Saake and T. Pionteck, "Efficient Inter-Kernel Communication for OpenCL Database Operators on FPGAs," 2018 International Conference on Field-Programmable Technology (FPT), Naha, Okinawa, Japan, 2018, pp. 266-269. 10.1109/FPT.2018.00050
2018	C. Blochwitz, J Wolff, M Berekovic, D Heinrich, S Groppe, JM Joseph, T Pionteck, "Hardware-Accelerated Index Construction for Semantic Web," 2018 International Conference on Field-Programmable Technology (FPT), Naha, Okinawa, Japan, 2018, pp. 278-281. 10.1109/FPT.2018.00053
2017	Jan Moritz Joseph, Morten Mey, Kristian Ehlers, Christopher Blochwitz, Tobias Winker, Thilo Pionteck: Design Space Exploration for a Hardware-accelerated Embedded Real-Time Pose Estimation using Vivado HLS, Reconfig, Cancun, Mexico, 2017.
2017	Tobias Drewes, Jan Moritz Joseph, Thilo Pionteck: An FPGA-based Prototyping Framework for Networks-on-Chip, Reconfig, Cancun, Mexico, 2017.
2017	Christopher Blochwitz, Raphael Klink, Jan Moritz Joseph, Thilo Pionteck: Continuous Live-Tracing as Debugging Approach on FPGAs, Reconfig, Cancun, Mexico, 2017.
2017	Jan Moritz Joseph, Lennart Bamberg, Sven Wrieden, Dominik Ermel, Alberto Garcia-Oritz, Thilo Pionteck: Design Method for Asymmetric 3D-Interconnect Architectures with High Level Models, ReCoSoC, Madrid, Spain, 2017.
2017	Jan Moritz Joseph, Christopher Blochwitz, Alberto García-Ortiz, Thilo Pionteck: Area and power savings via buffer reorganization in asymmetric 3D-NoCs for heterogeneous 3D-SoCs, MICPRO 2460, 2017.
2016	Christopher Blochwitz, Julian Wolff, Jan Moritz Joseph, Stefan Werner, Dennis Heinrich, Sven Groppe, Thilo Pionteck: Hardware-accelerated Radix-Tree based string sorting for Big Data applications, ARCS 2017.
2016	Jan Moritz Joseph, Tobias Winker, Kritian Ehlers, Christopher Blochwitz, Thilo Pionteck: Hardware-Accelerated Pose Estimation for Embedded Systems using Vivado HLS , Reconfig, Cancun, Mexiko, 2016. preprint, poster
2016	Jan Moritz Joseph, Sven Wrieden, Christopher Blochwitz, Alberto García-Ortiz, Thilo Pionteck: A Simulation Environment for Design Space Exploration for Asymmetric 3D-Network-on-Chip, 11th International Symposium on Reconfigurable Communication-centric Systems-on-Chip (ReCoSoC 2016), Tallinn, 2016. presentation, preprint
2016	Jan Moritz Joseph, Christopher Blochwitz, Thilo Pionteck: Adaptive Allocation of Default Router Paths in Network-on-Chips for Latency Reduction, 2016 International Conference on High Performance Computing & Simulation (HPCS), Innsbruck, 2016. presentation, preprint
2015	Jan Moritz Joseph, Christopher Blochwitz, Alberto García-Ortiz, Thilo Pionteck: Area and power savings via buffer reorganization in asymmetric 3D-NoCs for heterogeneous 3D-SoCs, Nordic Circuits and Systems Conference (NORCAS), Oslo, 2015. preprint
2015	Christopher Blochwitz, Jan Moritz Joseph, Rico Backasch, Stefan Werner, Dennis Heinrich, Sven Groppe, Thilo Pionteck; An optimized Radix-Tree for hardware-accelerated index generation for Semantic Web Databases, Reconfig, Cancun, Mexiko, 2015
2015	Jan Moritz Joseph, Thilo Pionteck; A Cycle-Accurate Network-on-Chip Simulator with Support for Abstract Task Graph, International Symposium on System-on-Chip, Tampere, 2014. presentation, preprint

Poster und kleinere Konferenzbeiträge

• Jan Moritz Joseph, Philipp Forster, Matthias Hudecek; "Digitalisierung von Change Management", 3. Tagung für Führung und Organisation, Berlin, 2016
• Jan Moritz Joseph, Jens Christian Claussen; "Dynamical model of the scientific process: Knowledge generation embedded in the scientific map of science", DPG Spring Meeting, Regensburg, 2016
• Jan Moritz Joseph, Matthias Hudecek; "Measurability and Characteristics of Structural Metrics and Business Scores for HR development", DPG Spring Meeting, Regensburg, 2016
• Jan Moritz Joseph, Jens Christian Claussen; "Modeling the evolution of science in scientific space", DPG Spring Meeting, Berlin, 2015
• Jan Moritz Joseph, Jens Christian Claussen; "A dynamical author-strategic growth model for the structure of science in scientific space", XXXIV Dynamics Days Europe, Bayreuth, 2014
• Jan Moritz Joseph, Jens Christian Claussen; "A Dynamical Model of Scientific Collaboration Networks", DPG Spring Meeting, Dresden, 2014

Disclaimer: Preprints are offered in compliance with the IEEE copyright policy: An FAQ on Intellectual Property Rights for IEEE Authors

Gutachtertätigkeit

Microprocessors and Microsystems, Elsevier; IEEE Transactions on Industrial Electronics

Betreute Abschlussarbeiten

• Tobias Winker. Generierung einer Hardwarebeschleunigung zur Gestenerkennung auf einem Xilinx Zynq unter Verwendung von High Level Synthesis. Bachelorarbeit, Universität zu Lübeck, 2016.
• Morten Mey. Entwurf und Implementierung eines hardwarebeschleunigten Algorithmus zur Gestenerkennung. Masterarbeit, Universität zu Lübeck, 2016.
• Tobias Drewes, Implementierung und Evaluation einer Adaptiven Auswahl von Standardpfaden in NoCs. Masterarbeit, Universität zu Lübeck, 2016.